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华中科技大学2025年11月至12月政府采购意向公开
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为便****政府采购信息，根据《****政府采购意向公开工作的通知》（财库〔2020〕10号）等有关规定，现将****2025年11月至12月政府采购意向公开如下：
| 序号 | 采购项目名称 | 意向编号 | 采购品目 | 采购需求概况 | 预算金额(万元) | 预计采购日期 | 备注 |
| 1 | 西七楼南楼维修项目 | **** | B****0000房屋修缮 | 项目主要实施内容为拆除西七楼南楼原有部分门头及室外挡墙，增设报告厅、学术交流室、教学展览空间等。计划工期：90天；质保期：防水五年，其它两年；质量标准：国家验收规范合格标准。 | 445 | 2025年12月 | |
| 2 | 芯片知识产权(IP)技术服务 | YX****00228 | C****0000其他服务 | 拟需RISC-V CPU硬核完成复杂计算场景中计算芯片的复杂任务调度和控制，构建高性能、可扩展的计算加速器系统。CPU硬核负责：1）系统控制与调度：作为主控单元，负责全面的系统初始化、任务管理与**配置。2）实时监控与优化：实时获取并分析图计算加速单元的执行状态和算法运行信息，据此进行动态的调度策略优化，以最大化计算**利用率。3）数据流协调：异步、高效地控制直接内存访问（DMA）引擎，实现计算单元与内存之间大规模数据的高带宽、低延迟搬运，确保计算任务流水线的顺畅。4）并发任务处理：负责对多个计算任务进行灵活的调度与分配，实现高效的并行处理能力。最终，该CPU硬核IP将与专用的图计算加速单元紧密协同，共同显著提升整个系统在处理复杂图算法（如路径搜索、社区发现等）时的整体性能、能效比和任务吞吐量。具体要求：RISC-V CPU：基于TSMC12FFC工艺，单cluster集成2 core，最高主频可达到2.5GHz，最多可扩展到48核，LLC最大可支持到64M，11级流水设计，可硬件预取，具有PMP安全处理机制，地址空间最大为44bit，面积小于10mm2，功耗低于4W；该CPU IP具有基于数据流(dataflow)理论的指令顺序重排优化、重命名机制优化、访存依赖优化及执行微架构逻辑模块优化设计。供应商须提供该IP核在以往成功流片并量产的相关案例及充分证明，证实其技术成熟度和可靠性。 | 195 | 2025年11月 |
本次公开的****政府采购工作的初步安排，具体采购项目情况以相关采购公告和采购文件为准。标书代写
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2025年10月24日
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