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| 由于该项目报价情况不满足要求,本项目延期至2025-11-05 17:00 |
符合《政府采购法》第二十二条规定的供应商基本条件
公告说明由于该项目报价情况不满足要求,本项目延期至2025-11-05 17:00| 芯来科技 | ||
| Nuclei DDR200T开发板 | ||
| FPGA 的基本硬件**: - Xilinx FPGA 芯片 (XC7A200T-2FBG484I) - 4Gb DDR3L SDRAM,32 位总线 (MT41K128M16JT-125K DDR III) - 两个晶体振荡器,Y1 用于 100MHz 时钟,Y2 用于 32.768K RTC 时钟 - FPGA_FLASH,独立的 SPI 闪存芯片,用于 FPGA 存储其比特流(MCS 格式) - FPGA_JTAG 接口,即板载 USB JTAG 编程器,用于编程 FPGA 的比特流 - 独立的 DC 12V 电源和一个电源开关 - FPGA_PROG 按钮,用于强制 FPGA 从外部闪存重新加载比特流 - MCU_FLASH,独立的闪存芯片,用于 RISC-V 核心(烧录在 FPGA 内部)存储其指令程序或只读数据 - MCU_JTAG 插座,即板载 JTAG 接口插座,用于 RISC-V 核心调试 - MCU_GPIO 端口 x4(兼容 PMOD 接口),用于 SoC 的 32 个 GPIO 引脚 - FPGA_RESET 按钮,用于 SoC 的上电复位(PoR) - MCU_RESET 按钮,用于 SoC 的系统复位 其他硬件**作为常规 FPGA 板**: - 用户 LED x8 - 用户按钮 x5 - 用户 DIP 开关(8 位) - XADC 端口(兼容 PMOD 接口) - 数字 7 段 LED 显示器(8 位) - 2.8 英寸 LCD 模块 - 用户 IIC EEPROM:24LC04 - FPGA SD 卡插槽 - UART 转 USB 桥接器 - FPGA USB-OTG 端口 - FPGA USB-HOST 端口 - FPGA 数字音频编解码器接口 - 10/100/1000 Mbps 以太网 RJ45 端口(GMII) - LORA 模块 RF SMA 端口 - LORA 模块 RESET 按钮 - LORA 模块 RELOAD 按钮 - FPGA 8G eMMC RISC-V MCU (GD32VF103) **: - GD32VF103 USB 端口 - GD32VF103 板载 USB JTAG 调试器端口 - GD32VF103 SD 卡插槽 - GD32VF103 PMOD 端口 - GD32VF103 Arduino 端口 - GD32VF103 MCU_NRST 按钮 - GD32VF103 PA0_WKUP 按钮 - GD32VF103 调试器选择跳线头 - GD32VF103 BOOT 跳线头 - GD32VF103 GPIO 跳线头(连接到 FPGA GPIO 或 Arduino 端口) |
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| 服务网点:不限;电话支持:7x24小时;服务时限:报修后24小时;质保期:两年; | ||
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2025-11-03 16:21:28