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| 由于该项目报价情况不满足要求,本项目延期至2026-06-24 11:00 |
| 专用测试数据采集卡开发 |
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| 2026-06-22 09:20:42 |
| 2026-06-24 11:00:00 |
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| 合同签订后付合同金额的90%,货到验收合格后付合同金额的10%。 |
| 成交后在我参与的项目中查看 |
| 成交后在我参与的项目中查看 |
| 成交后10天内 |
| 签约后120天内 |
| ¥ 350,000.00 |
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| 符合《政府采购法》第二十二条规定的供应商基本条件 |
| 由于该项目报价情况不满足要求,本项目延期至2026-06-24 11:00 |
| 专用测试数据采集卡开发 | 1 | 项 | 无 |
| ¥ 350,000.00 |
| 功能要求: 1)支持2路千兆以太网(TCP/IP或UDP); 2)支持8通道模拟量采集:-10V~+10V,≥200kΩ,≥16bit,≥1MSa/s,精度≤±0.5%FSR,通道电气隔离; 3)支持10路数字量输入(3.3V/5V/24V可跳线,≥2Mbit/s); 4)支持4路数字量输出(3.3V/5V/24V可配置,≤50mA); 5)采集通道支持触发、脉宽计数、占空比计算、协议解析; 6)元器件工业级以上,国产化率100%。 性能指标要求: 1)主控:ZYNQ-FPGA(FMQL10S400或兼容),双ARM核,支持FPGA编程; 2)存储:2片4Gb DDR3缓存 + EEPROM校准存储; 3)模拟通道:仪表放大器+有源滤波+ADC(16bit/1MSa/s)+隔离DC-DC+数字隔离器; 4)数字通道:高速光耦(输入10路/输出4路),输出加三极管驱动; 5)数采逻辑:SPI主机控制器,状态机+串并转换+FIFO+握手协议; 6)解码逻辑:A/B/Z三路输入,四倍频状态机,32位计数器,M/T法测速; 7)网络逻辑:RGMII接口,MAC层,UDP/TCP/IP协议栈,MDIO管理; 8)上层协议:定长帧头(16字节含时间戳、CRC16)+变长载荷; 9)上位机:Qt/C++,含通信层、数据处理层、UI层、控制层、存储层。 交付要求: 1)采集卡样板 4套; 2)设计文档(硬件/逻辑/软件)1套; 3)测试报告 1套; 4)元器件清单 1套; 5)用户使用手册 1套。 |