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电子科技大学 - 竞价结果公告（CB106142026000118）
招标详情
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**** - 竞价结果公告（****）
发布时间：2026-07-10 10:16:16
申购单号： ****
申购主题： SG202****051001博弈多点目标BX模拟模块
采购单位： ****
竞价开始时间： 2026-07-03 12:56:53
竞价截至时间： 2026-07-09 16:41:19
币种： 人民币
付款方式： 货到验收合格后付款
备注说明：
质疑说明： 如果对成交结果有异议，请在发布成交结果之日起三个工作日内向采购单位提出质疑
成交总额： 215000.00
送货时间： 合同签订后7天内送达
安装要求： 免费上门安装（含材料费）
收货地址：
| SG202****051001博弈多点目标BX模拟模块 | **** | 230000.00 | 215000.00 | 按行业标准提供服务 | 通道数 2 路单端，同步更新 分辨率 12 bit 最大采样率 单通道：6.4 GS/s；双通道：3.2 GS/s 直接 RF 输出频率范围 单通道：≤3 GHz；双通道：≤1.5 GHz 输出阻抗 50 Ω（SMA 接口） 输出耦合 AC 耦合 电压范围 1 Vpp（峰峰值） FPGA 型号 Xilinx Kintex UltraScale KU040 逻辑单元（LUT/FF） 约 403k LUT，504k FF DSP48 切片 1,920 个（25×18 乘法器） 块 RAM（BRAM） 21.1 Mb 嵌入式 DRAM 4 GB（2×2 GB），1064 MHz，32 bit 位宽 DRAM 理论带宽 17 GB/s（8.5 GB/s 每 bank） 高速收发器（MGT） 4 路 GTH Tx±/Rx±，速率 500 Mbps–16.375 Gbps 数字 I/O（DIO） 8 路单端双向，支持 3.3/2.5/1.8/1.5/1.2 V 电平 PXIe 总线 Gen3 x8，DMA 带宽达 7 GB/s 参考时钟 PXIe_CLK100（100 MHz），支持多模块同步 DMA 通道数 具有两组独立DDR4芯片； 具有PCIe Gen3 x8链路通信功能； 具有连接背板支持PXIe规范要求的同步触发线； 具有中频信号采集，通过PCIe总线上传功能； 具有通过PCIe总线下发数据，信号产生功能； 具备多板同步功能。 需提供底层FPGA基础工程，包含DDR4控制器、PCIe核、时钟管理等基本功能； "支持对大型舰船目标（尺度约150m）进行 ≥15 个等效散射点建模，生成 400MHz 宽带线性调频脉冲回波信号，" 支持对雷达发射信号进行截获、存储、延迟与转发全流程模拟，采样时间 5μs、转发时间 5μs，干扰相对目标回波滞后 2μs，可独立生成符合典型电子对抗场景的切片转发干扰回波信号。 "与第三方显控程序之间采用共享网络文件目录解耦交互，接口涵盖场景剧本接收、回波数据上传、真值数据输出、运行状态上报等 9 类标准化协议，支持 UTF-8 JSON 控制文件与 int16 LE 二进制回波数据格式，采用原子写入机制确保数据完整性。" | 1.0 | XJ-KU04-DA2 | 215000.00 | **** |
招标进度跟踪
2026-07-10
中标通知
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